在電子綫路設計領域中,設計自動化工具已經逐步為設計者所接受,它必將取代人工設計方法,成為主要的設計手段。目前,VHDL已成為許多設計自動化工具普遍彩用的標準化硬件描述語言。掌握VHDL語言,用VHDL語言設計電子綫路,是電子綫路設計者必須掌握的基本技能。VHDL語言功能強,覆蓋麵大,靈活性高,但對於初學者來說,用VHDL語言描述電路有很大難度。為解決這個問題,本書除瞭介紹VHDL基本語言
發表於2024-12-21
用VHDL 設計電子綫路 2024 pdf epub mobi 電子書 下載
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