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SystemVerilog For Design
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SystemVerilog For Design pdf epub mobi 著者簡介

SystemVerilog For Design pdf epub mobi 圖書描述

SystemVerilog is a rich set of extensions to the IEEE 1364-2001 Verilog Hardware Description Language (Verilog HDL). These extensions address two major aspects of HDL based design. First, modeling very large designs with concise, accurate, and intuitive code. Second, writing high-level test programs to efficiently and effectively verify these large designs. This book, SystemVerilog for Design, addresses the first aspect of the SystemVerilog extensions to Verilog. Important modeling features are presented, such as two-state data types, enumerated types, user-defined types, structures, unions, and interfaces. Emphasis is placed on the proper usage of these enhancements for simulation and synthesis. A companion to this book, SystemVerilog for Verification, covers the second aspect of SystemVerilog.

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發表於2024-11-07

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SystemVerilog For Design pdf epub mobi 讀後感

評分☆☆☆☆☆

這本書主要是從硬件方麵來對SV進行介紹的，也就是介紹SV在硬件實現方麵的強大功能。 很好的一點是，它是對照著verilog來介紹的。同樣的功能，Verilog會怎樣處理，而SV又會怎樣處理，這樣能夠很容易地加深對SV的理解。 看這本書用瞭我2天的時間。當然，隻是粗略讀瞭一遍，但是...

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出版者:Springer
作者:Stuart Sutherland
出品人:
頁數:402
譯者:
出版時間:2003-06-30
價格:USD 130.00
裝幀:Hardcover
isbn號碼:9781402075308
叢書系列:

圖書標籤: systemverilog  verilog  ic   

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