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SystemVerilog for Design Second Edition

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SystemVerilog for Design Second Edition pdf epub mobi 著者簡介

SystemVerilog for Design Second Edition pdf epub mobi 圖書描述

In its updated second edition, this book has been extensively revised on a chapter by chapter basis. The book accurately reflects the syntax and semantic changes to the SystemVerilog language standard, making it an essential reference for systems professionals who need the latest version information. In addition, the second edition features a new chapter explaining the SystemVerilog "packages", a new appendix that summarizes the synthesis guidelines presented throughout the book, and all of the code examples have been updated to the final syntax and rerun using the latest version of the Synopsys, Mentor, and Cadance tools.

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SystemVerilog for Design Second Edition pdf epub mobi 讀後感

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這本書主要是從硬件方麵來對SV進行介紹的，也就是介紹SV在硬件實現方麵的強大功能。很好的一點是，它是對照著verilog來介紹的。同樣的功能，Verilog會怎樣處理，而SV又會怎樣處理，這樣能夠很容易地加深對SV的理解。看這本書用瞭我2天的時間。當然，隻是粗略讀瞭一遍，但是...

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出版者:Springer

作者:Stuart Sutherland

出品人:

頁數:418

譯者:

出版時間:2006-8-21

價格:USD 189.00

裝幀:Hardcover

isbn號碼:9780387333991

叢書系列:

圖書標籤: 編程外國技術 verification 電路設計 verilog tech-software system ic

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